IEEE Std 62530-2007 是电气电子工程师学会的技术标准,题为“IEC 62530 Ed. 1 (IEEE Std 1800(TM)-2005): Standard for SystemVerilog - Unified Hardware Design, Specification, and Verification Language”;公开目录标为已被替代(Superseded),著录年份为 2007 年。
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